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要使用 make
命令编译文件,首先需要创建一个 Makefile
文件来定义编译规则和依赖关系。Makefile
是一个文本文件,包含了一系列的规则,每个规则定义了如何生成一个或多个目标文件。
以下是一个简单的 Makefile
示例:
CC = gcc
CFLAGS = -Wall
all: program
program: main.o functions.o
$(CC) $(CFLAGS) -o program main.o functions.o
main.o: main.c
$(CC) $(CFLAGS) -c main.c
functions.o: functions.c
$(CC) $(CFLAGS) -c functions.c
clean:
rm -f program *.o
在这个 Makefile
中,定义了一个 all
规则来编译生成 program
可执行文件。program
依赖于 main.o
和functions.o
两个目标文件,分别对应 main.c
和functions.c
两个源文件。同时定义了 clean
规则来清理生成的目标文件和可执行文件。
编译文件时,只需要在命令行中输入 make
命令即可:
$ make
这样 make
命令会根据 Makefile
中的规则和依赖关系,自动编译生成可执行文件。如果只想编译某个特定的目标文件,可以在 make
命令后跟目标文件名,例如:
$ make main.o
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